VHDL——2选1多路通道

待我称王封你为后i 2023-10-04 10:22 2阅读 0赞

1.逻辑电路  
![watermark_type_ZmFuZ3poZW5naGVpdGk_shadow_10_text_aHR0cHM6Ly9ibG9nLmNzZG4ubmV0L20wXzU0MzU1MTcy_size_16_color_FFFFFF_t_70][]  
2.端口  
![在这里插入图片描述][watermark_type_ZmFuZ3poZW5naGVpdGk_shadow_10_text_aHR0cHM6Ly9ibG9nLmNzZG4ubmV0L20wXzU0MzU1MTcy_size_16_color_FFFFFF_t_70 1]  
3.VHDL语言

3.1使用并行语句

library ieee;
    use ieee.std_logic_1164.all;
    
    entity mux21 is
      port(
        a,b,s:in bit;
    	 q:out bit
      );
    end mux21;
    
    architecture mux of mux21 is
    begin 
      q <= a when s ='0' 
      else b;
    end mux;

3.2使用布尔方程表达式

architecture mux of mux21 is
    begin 
      q<=(a and (not s))or(b and s);
    end mux;

3.3使用顺序语句

architecture mux of mux21 is
    begin 
     process(a,b,s)
       if s='0'then
         q<=a;
    	else 
         q<=b;
    	end if; 
      end process;
    end mux;

[watermark_type_ZmFuZ3poZW5naGVpdGk_shadow_10_text_aHR0cHM6Ly9ibG9nLmNzZG4ubmV0L20wXzU0MzU1MTcy_size_16_color_FFFFFF_t_70]: https://img-blog.csdnimg.cn/20210410150558682.png?x-oss-process=image/watermark,type_ZmFuZ3poZW5naGVpdGk,shadow_10,text_aHR0cHM6Ly9ibG9nLmNzZG4ubmV0L20wXzU0MzU1MTcy,size_16,color_FFFFFF,t_70
[watermark_type_ZmFuZ3poZW5naGVpdGk_shadow_10_text_aHR0cHM6Ly9ibG9nLmNzZG4ubmV0L20wXzU0MzU1MTcy_size_16_color_FFFFFF_t_70 1]: https://img-blog.csdnimg.cn/20210410150609155.png?x-oss-process=image/watermark,type_ZmFuZ3poZW5naGVpdGk,shadow_10,text_aHR0cHM6Ly9ibG9nLmNzZG4ubmV0L20wXzU0MzU1MTcy,size_16,color_FFFFFF,t_70

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